多核多线程处理器 SPARC64™ VII和VI

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SPARC64 VII/VI 增强了SPARC64 V 的高性能和高可靠性特性，通过单个CPU芯片中内嵌的多核多线程技术进一步提高性能。SPARC64 VII每个CPU芯片有4个核，SPARC64 VI每个CPU芯片有2个核。

芯片多核、每核多线程，大容量片上高速缓存，都大大提高了芯片的性能。

多线程技术最小化 CPU 内核的等待时间，增加了 CPU内核的利用率。在SPARC64 VII中，SMT（同时多线程技术）使得两个线程可以并行运行。在SPARC64 VI中，VMT（垂直多线程技术）使得线程得以被高效的执行。

大容量二级高速缓存极大降低了内存延迟。

SPARC64 V 的高性能技术，如超标量、乱序执行、分支预测和非阻塞缓存都得以延续。

采用高性能的 SPARC64 VII/VI 芯片SPARC Enterprise ，可提供包括大规模交易处理在内各种应用所需的高超性能。

高性能技术

单芯片性能通过芯片中的多核技术得到极大改进，其中SPARC64 VII可达4核，SPARC64 VI可达双核。

多线程技术减少了 CPU 核的等待时间，增加了 CPU核的利用率。在SPARC64 VII/VI中，每核双线程以很高的效率执行。

在每核只有一个线程的处理器中，内存访问时指令执行被挂起，数据读取操作完成时才继续执行。

这样的线性指令执行很花时间。

在使用了VMT机制的SPARC64 VI处理器中，当线程1/进程1 开始内存访问时，指令控制切换到线程2，线程2/进程2 开始执行。当线程2开始内存访问时，指令控制切换回线程1，挂起的线程1/进程1继续执行。

两个线程的切换机制减少了处理器的等待时间，有效利用了内存访问时间，提高中高端 SPARC Enterprise服务器的性能。

在SPARC64 VII中使用了SMT机制，线程1和线程2可以并行运行，最小化了处理时间。

SPARC64 VII/VI 综合了各种高性能技术，包括：无序执行，有可执行数据时就开始指令执行；以及分支预测机制，预测并为最有可能的指令序列做好准备。